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Así que veamos las instrucciones de carga enlazada/almacenamiento condicional, que generalmente llamamos instrucción LL/SC. Las tenemos porque la lectura y escritura atómica en la misma instrucción, incluso si solo hacemos la escritura, si la lectura ha dado positivo por algo. Es realmente malo para el pipeline de tu procesador. Veamos el clásico pipeline de cinco etapas donde obtenemos el código y leemos registros. Hacemos la operación de área. Aquí es donde se calcula la dirección para instrucciones de memoria. Luego tenemos una etapa de acceso a memoria y finalmente, escribimos el resultado en un registro, si un registro resultante existe en la instrucción. Las cargas se obtendrán, decodificarán y leerán el registro, calcularán la dirección usando ese registro, accederán a la memoria para obtener el valor de esa dirección y luego escribirán el resultado en un registro. Una instrucción de lectura/escritura atómica, como un intercambio, o prueba y establecer, o prueba y escribir, calcularía la dirección y leería registros. Y luego, cuando llega a la etapa de memoria, no puede hacer todo lo que necesita
